最近在做一个5G基站项目,遇到了多层板阻抗控制的问题。这个项目要求单端50Ω±5%,差分100Ω±5%,涉及12个信号层的阻抗匹配。分享一下我的实战经验。
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大家在高速设计中还有什么好的经验?欢迎交流讨论。

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最近在做一个5G基站项目,遇到了多层板阻抗控制的问题。这个项目要求单端50Ω±5%,差分100Ω±5%,涉及12个信号层的阻抗匹配。分享一下我的实战经验。
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阻抗控制确实是高速设计的核心。补充一点:参考平面的连续性比间距更重要,跨分割区域走线是大忌。
SI9000确实好用,不过我们现在改用Saturn PCB Toolkit了,免费而且精度也不错。另外建议关注一下TDR实测验证环节。
背钻工艺的成本不低,如果频率在10GHz以下,可以考虑用微盲孔代替通孔来减少stub长度。
请问楼主用的什么板材?高频板材的Dk公差对阻抗影响很大,建议选择±0.05公差的型号。
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张明远
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